TMS320C6747DZKBA3 456MHz DSP Dual-Core 3648MBPS 32KB Cache L1 256KB RAM BGA-256 -40°C a +100°C DSP Industrial

TMS320C6747DZKBA3 456MHz DSP Dual-Core de 3648MBPS 32KB L1 Cache 256KB RAM BGA-256 -40anddeg;C a +100anddeg;C DSP Industrial

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Características andnbsp;

andbull; Suporte de Software

andndash; TI DSP/BIOSandtrade;

andndash; Biblioteca de Suporte de Chip e Biblioteca DSP

andbull; DSP TMS320C674x de 375 e 456 MHz VLIW

andbull; Características do Conjunto de Instruções C674x

andndash; Superconjunto das ISAs C67x+ e C64x+

andndash; Até 3648 MIPS e 2736 MFLOPS C674x

andndash; Endereçável por Byte (Dados de 8, 16, 32 e 64 bits)

andndash; Proteção contra estouro de 8 bits

andndash; Extração, Definição e Limpeza de Campo de Bits

andndash; Normalização, Saturação, Contagem de Bits

andndash; Instruções Compactas de 16 bits

andbull; Arquitetura de Memória Cache de Dois Níveis C674x

andndash; 32KB de RAM/Cache de Programa L1P

andndash; 32KB de RAM/Cache de Dados L1D

andndash; 256KB de RAM/Cache Mapeada Unificada L2

andndash; Partição RAM/Cache Flexível (L1 e L2)

andbull; Controlador de Acesso Direto à Memória Aprimorado 3 (EDMA3):

andndash; 2 Controladores de Transferência

andndash; 32 Canais DMA Independentes

andndash; 8 Canais DMA Rápidos

andndash; Tamanho de Burst de Transferência Programável

andbull; Núcleo DSP VLIW de Ponto Fixo e Ponto Flutuante TMS320C674x

andndash; Arquitetura Load-Store com Suporte Não Alinhado

andndash; 64 Registradores de Uso Geral (32 bits)

andndash; Seis Unidades Funcionais ALU (32 e 40 bits)

andndash; Suporta Inteiro de 32 bits, SP (Precisão Simples IEEE/32 bits) e DP (Precisão Dupla IEEE/64 bits) de Ponto Flutuante

andndash; Suporta até Quatro Adições SP por Clock, Quatro Adições DP a Cada 2 Clocks

andndash; Suporta até Duas Operações de Aproximação Recíproca (RCPxP) e Aproximação Recíproca de Raiz Quadrada (RSQRxP) de Ponto Flutuante (SP ou DP) por Ciclo

andndash; Duas Unidades Funcionais de Multiplicação

andndash; Multiplicação de Ponto Flutuante IEEE de Precisão Mista Suportada até:

andndash; 2SPxSP->SPPorClock

andndash; 2SPxSP->DPA Cada Dois Clocks

andndash; 2SPxDP->DPA Cada Três Clocks

andndash; 2DPxDP->DPA Cada Quatro Clocks

andndash; Multiplicação de Ponto Fixo Suporta Duas Multiplicações de 32 x 32 bits, Quatro Multiplicações de 16 x 16 bits ou Oito Multiplicações de 8 x 8 bits por Ciclo de Clock e Múltiplos Complexos

andndash; Empacotamento de Instruções Reduz o Tamanho do Código

andndash; Todas as Instruções Condicionais

andndash; Suporte de Hardware para Operação de Loop Modulo

andndash; Operação em Modo Protegido

andndash; Suporte a Exceções para Detecção de Erros e Redirecionamento de Programa

andbull; 128KB de Memória RAM Compartilhada (Somente TMS320C6747)

andbull; E/S LVCMOS de 3,3 V (Exceto para Interfaces USB)

andbull; Duas Interfaces de Memória Externa:

andndash; EMIFA

andndash; NOR (Dados de 8 ou 16 bits de largura)

andndash; NAND (Dados de 8 ou 16 bits de largura)

andndash; SDRAM de 16 bits com Espaço de Endereçamento de 128 MB (Somente TMS320C6747)

andndash; EMIFB

andndash; SDRAM de 32 bits ou 16 bits com Espaço de Endereçamento de 256 MB (TMS320C6747)

andndash; SDRAM de 16 bits com Espaço de Endereçamento de 128 MB (TMS320C6745)

andbull; Três Módulos UART Tipo 16550 Configuráveis:

andndash; UART0 com Sinais de Controle de Modem

andndash; Sinais de Controle de Fluxo Automático (CTS, RTS) Somente em UART0

andndash; FIFO de 16 Bytes

andndash; Opção de Sobreamostragem 16x ou 13x

andbull; Controlador LCD (Somente TMS320C6747)

andbull; Duas Interfaces Periféricas Seriais (SPIs), Cada Uma com uma Seleção de Chip

andbull; Interface de Cartão Multimídia (MMC)/Cartão Secure Digital (SD) com E/S de Dados Segura (SDIO)

andbull; Dois Circuitos Integrados Inter-Integrados (Barramento I2Candtrade;)

andbull; Uma Interface de Porta Host (HPI) com Barramento de Dados/Endereço Multiplexado de 16 bits para Alta Largura de Banda (Somente TMS320C6747)

andbull; Subsistema de Unidade de Tempo Real Programável (PRUSS)

andndash; Dois Núcleos de Unidade de Tempo Real Programável (PRU) Independentes

andndash; Arquitetura RISC de Carregamento e Armazenamento de 32 bits

andndash; 4KB de RAM de Instrução por Núcleo

andndash; 512 Bytes de RAM de Dados por Núcleo

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Aplicações

andbull; Receptores A/V

andbull; Amplificadores Automotivos

andbull; Soundbars

andbull; Sistemas de Home Theater

andbull; Áudio Profissional

andbull; Áudio de Streaming de Rede

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Descrição

O dispositivo TMS320C6745/6747 é um processador de sinal digital de baixa potência baseado em um núcleo DSP TMS320C674x. Ele consome significativamente menos energia do que outros membros da plataforma TMS320C6000andtrade; de DSPs.

O dispositivo TMS320C6745/6747 permite que os fabricantes de equipamentos originais (OEMs) e os fabricantes de design original (ODMs) lancem rapidamente no mercado dispositivos com alto desempenho de processamento.

O núcleo DSP TMS320C6745/6747 usa uma arquitetura baseada em cache de dois níveis. O cache de programa de nível 1 (L1P) é um cache mapeado diretamente de 32 KB e o cache de dados de nível 1 (L1D) é um cache associativo de 2 vias de 32 KB. O cache de programa de nível 2 (L2P) consiste em um espaço de memória de 256 KB que é compartilhado entre o espaço de programa e dados. A memória L2 pode ser configurada como memória mapeada, cache ou combinações dos dois. Embora o DSP L2 seja acessível por outros hosts no sistema, uma memória RAM compartilhada adicional de 128 KB (somente TMS320C6747) está disponível para uso por outros hosts sem afetar o desempenho do DSP.

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INFORMAÇÕES

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Desenho

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