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AD9518-3ABCPZ Gerador de Relógio de Baixo Jitter com saídas configuráveis PLL e VCO 8 (LVPECL/LVDS/CMOS) Síntese de Frequência Integer-N para Relógio ADC/DAC e FPGA de Alta Velocidade

CHINA TOP Electronic Industry Co., Ltd. Certificações
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AD9518-3ABCPZ Gerador de Relógio de Baixo Jitter com saídas configuráveis PLL e VCO 8 (LVPECL/LVDS/CMOS) Síntese de Frequência Integer-N para Relógio ADC/DAC e FPGA de Alta Velocidade

AD9518-3ABCPZ Gerador de Relógio de Baixo Jitter com saídas configuráveis PLL e VCO 8 (LVPECL/LVDS/CMOS) Síntese de Frequência Integer-N para Relógio ADC/DAC e FPGA de Alta Velocidade
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Imagem Grande :  AD9518-3ABCPZ Gerador de Relógio de Baixo Jitter com saídas configuráveis PLL e VCO 8 (LVPECL/LVDS/CMOS) Síntese de Frequência Integer-N para Relógio ADC/DAC e FPGA de Alta Velocidade

Detalhes do produto:
Lugar de origem: China
Marca: ADI
Certificação: CE, GCF, ROHS
Número do modelo: AD9518-3ABCPZ
Condições de Pagamento e Envio:
Quantidade de ordem mínima: 1
Preço: negotiable
Detalhes da embalagem: Embalado na bandeja original primeiro, depois a caixa, finalmente a bolsa de bolha para embalagem ex
Tempo de entrega: 3-5 dias úteis após receber o pagamento
Termos de pagamento: T/T, União Ocidental,
Habilidade da fonte: 1000pcs por mês
Descrição de produto detalhada
Função: Advertido, intensificador Configuração de saída: Positivo ou negativo
Topologia: Buck, Boost Tipo de saída: Ajustável
Número de saídas: 1
Destacar:

AD9518-3ABCPZ gerador de relógio de baixo jitter

,

Gerador de relógio PLL VCO para FPGA

,

LVPECL LVDS CMOS clock synthesizer

AD9518-3ABCPZ Gerador de Clock de Baixo Jitter com PLL e VCO 8 Saídas Configuráveis (LVPECL/LVDS/CMOS) Síntese de Frequência Integer-N Para Clocking de ADC/DAC e FPGA de Alta Velocidade

 

Recursos

Loop de travamento de fase (PLL) de baixo ruído de fase

  VCO no chip sintoniza de 1,75 GHz a 2,25 GHz

  VCO/VcXo externo até 2,4 GHz opcional

  1 entrada de referência diferencial ou 2 de extremidade única

  Capacidade de monitoramento de referência

  Reversão automática e referência manual

    modos de comutação/retenção

  Aceita referências LVPECL, LVDS ou CMos até 250 MHz

  Atrasos programáveis no caminho para PFD

  Detecção de travamento digital ou analógica, selecionável

3 pares de saídas LVPECL de 1,6 GHz

  Cada par de saída compartilha um divisor de 1 a 32 com atraso de fase grosseiro

    atraso de fase

  Jitter de saída aditivo: 225 fs rms

  Skew canal a canal de pares de saída de<10 ps

Sincronização automática de todas as saídas na inicialização

Sincronização manual de saída disponível

Disponível em LFCSP de 48 leads

 

Aplicações

Distribuição de clock de baixo jitter e baixo ruído de fase

Placas de linha de rede de 10/40/100 Gb/s, incluindo SONET

  Ethernet Síncrona, OTU2/3/4

Correção de erro direta (G.710)

Clocking de ADCs, DACS, DDSS, DDCS, DUCS, MxFES de alta velocidade

Transceptores sem fio de alto desempenho

ATE e instrumentação de alto desempenho

 

Descrição

O AD9518-31 fornece uma função de distribuição de clock multissaída com desempenho de jitter sub-picossegundo, juntamente com um PLL e VCO no chip. O VCO no chip sintoniza de 1,75 GHz a 2,25 GHz. Opcionalmente, um VCO/VCXO externo de até 2,4 GHz pode ser usado. O AD9518-3 enfatiza baixo jitter e ruído de fase para maximizar o desempenho do conversor de dados, e pode beneficiar outras aplicações com requisitos exigentes de ruído de fase e jitter. O AD9518-3 possui seis saídas LVPECL (em três pares). As saídas LVPECL operam até 1,6 GHz. Para aplicações que requerem saídas adicionais, uma entrada de referência de cristal, zero-delay ou EEPROM para configuração automática na inicialização, os AD9520 e AD9522 estão disponíveis. Além disso, os AD9516 e AD9517 são semelhantes ao AD9518, mas têm uma combinação diferente de saídas. Cada par de saídas possui divisores que permitem definir tanto a razão de divisão quanto o atraso grosseiro (ou fase). A faixa de divisão para as saídas LVPECL é de 1 a 32. O AD9518-3 está disponível em LFCSP de 48 leads e pode ser operado a partir de uma única fonte de 3,3 V. Um VCO externo, que requer uma faixa de tensão estendida, pode ser acomodado conectando a fonte de bomba de carga (VCP) a 5 V. Uma fonte de alimentação LVPECL separada pode ser de 2,5 V a 3,3 V (nominal). O AD9518-3 é especificado para operação na faixa industrial de −40°C a +85°C.

 

INFORMAÇÃO

categoria
Circuitos Integrados (CIs)
Geradores de clock, PLLs, sintetizadores de frequência
fabricante
Analog Devices Inc.
série
-
Embalagem
Bandeja
Status da peça
À venda
DigiKey é programável
Não verificado
Tipo
Gerador de clock, distribuição fan out
PLL
é
Entrada
CMOS,LVDS,LVPECL
saída
LVPECL
Número de circuitos
1
Razão - Entrada: Saída
1:6
Diferencial - Entrada: Saída
Sim/Sim
Frequência - máxima
2,25 GHz
Crossover/multiplicador
Sim/Nenhum
Tensão - fonte de alimentação
3,135 V ~ 3,465 V
Temperatura de operação
-40°C ~ 85°C
Tipo de montagem
Tipo de montagem em superfície
Pacote/Invólucro
48-VFQFN Pad, CSP
Pacotes de dispositivos do fornecedor
48-LFCSP-VQ(7x7)
Número base do produto
AD9518
Desenho

 

Nossa vantagem:

AD9518-3ABCPZ Gerador de Relógio de Baixo Jitter com saídas configuráveis PLL e VCO 8 (LVPECL/LVDS/CMOS) Síntese de Frequência Integer-N para Relógio ADC/DAC e FPGA de Alta Velocidade 0

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Contacto
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Pessoa de Contato: Mrs. Natasha

Telefone: 86-13723770752

Fax: 86-755-82815220

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